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College of Engineering
School of Electrical Engineering
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SCIE
SCOPUS
A DLL-Based Quadrature Clock Generator With a 3-Stage Quad Delay Unit Using the Sub-Range Phase Interpolator for Low-Jitter and High-Phase Accuracy DRAM Applications
Yoon, Youngbog; Park, Hyunsu; Kim, Chulwoo
Article
Issue Date
2020
Citation
IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS II-EXPRESS BRIEFS, v.67, no.11, pp.2342 - 2346
Publisher
IEEE-INST ELECTRICAL ELECTRONICS ENGINEERS INC
1
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저자/발명자/참여자
KIM, Chul woo
1
Yoon, Youngbog
1
키워드
ADDLL
1
Delay lines
1
Delays
1
DRAM
1
Generators
1
Jitter
1
LOCKED LOOP
1
MDLL
1
MPCG
1
multi-phase clock generator
1
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